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+# EDA Log Dataset for IC Debugging
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+## 📌 專案背景
+本數據集為 **2026 智慧創新大賞 (Best AI Awards)** 參賽專案「Agentic-EDA Copilot」之核心組件。
+旨在解決 IC 設計流程中，RTL 到 GDS 迭代產生的海量非結構化 Log 解析難題。
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+## 📊 數據內容
+本數據集包含模擬的 EDA 工具（如 OpenROAD）執行日誌，涵蓋以下關鍵偵測類別：
+- **Timing Violations**: 包含 WNS (Worst Negative Slack) 與 TNS 違規樣例。
+- **Physical Design Rules**: 包含 Multi-driven net 與 Latch inferred 等電路錯誤。
+- **Hybrid Metadata**: 經過正則解析萃取後的結構化欄位（Severity, Line Number, Module Name）。
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+## 🔗 相關連結
+- **GitHub Repository**: [在此貼上你的 GitHub 連結]
+- **核心技術**: 基於 n8n Workflow 與 Agentic RAG 架構。
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+## 🛠️ 使用說明
+本數據集配合專用的 Hybrid Parser，可將偵錯效率提升接近 100%，消除大語言模型的幻覺問題。